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國立中興大學 電機工程學系所 楊清淵所指導 林彥辰的 具自適性等化器之3-Gb/s 1/3-速率全差動時脈與資料回復電路 （2017），提出pump it up抖音關鍵因素是什麼，來自於自適性等化器、鎖相迴路、時脈資料回復電路。

而第二篇論文國立中興大學 電機工程學系所 楊清淵所指導 劉家棋的 應用於3-Gb/s類比等化器結合鎖相迴路基底之週期性嵌入式時脈編碼時脈與資料回復電路 （2017），提出因為有 類比等化器、時脈與資料回復電路、週期性嵌入式時脈編碼、鎖相迴路的重點而找出了 pump it up抖音的解答。

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接下來讓我們看這些論文和書籍都說些什麼吧：

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具自適性等化器之3-Gb/s 1/3-速率全差動時脈與資料回復電路

為了解決pump it up抖音的問題，作者林彥辰 這樣論述：

由於近年來半導體製程快速發展，提升了整體電路的操作速度，消費性電子產品顯示畫質也變得越來越高。由較早期的解析度480P(640×480)至到目前主流畫質Full HD 1080P(1920×1080)，加上目前行動裝置與電視之間影音串流應用快速發展，因此顯示器的高速介面電路必須達到更高的傳輸速率來滿足高畫質的影音傳輸。為了達到下個世代高解析度Ultra HD 4K2K(3840×2160)的規格，應用在大型顯示器的高速介面電路由早期的多點傳輸變成點對點傳輸來達到更高速、低功耗的特性。本論文之設計主要針對大型顯示器高速介面中的嵌入式時脈差分訊號為目標，並透過自適性等化器結合1/3-速率取樣方式

來實現時脈與資料回復電路。 本論文第一部分所設計實現的3-Gb/s具有振幅控制迴路類比等化器可以補償大尺寸顯示器在1.5-GHz時24-dB的通道損失。為了解決輸入、輸出限幅放大器振幅不同，以及高頻補償空間受到低頻補償而造成壓縮的問題，本論文採用具有振幅控制迴路的系統架構。本晶片以聯電0.18-μm 1P6M CMOS製程來實現，在工作電壓為1.8-V時，其功率消耗為27-mW，而核心部分面積為0.12-(mm)^2，輸出峰對峰值抖動為0.256-UI。 本論文第二部分所實現的3-Gb/s具自適性等化器之時脈與資料回復電路，為了達到高速、低功耗、低抖動的特性，我們提出1/3-速率取樣技術，

除此之外整個系統架構採用全差動的方式來完成。本晶片以聯電0.18-μm 1P6M CMOS製程來實現，在工作電壓為1.8-V時，取樣速率為1-Gb/s時，其功率消耗為112-mW，而核心部分面積為0.36-(mm)^2，回復時脈峰對峰值抖動為5.07-ps，並列3組輸出的回復資料峰對峰值抖動分別為5.31、4.75、4.23-ps。

應用於3-Gb/s類比等化器結合鎖相迴路基底之週期性嵌入式時脈編碼時脈與資料回復電路

為了解決pump it up抖音的問題，作者劉家棋 這樣論述：

高速傳輸介面不斷朝著更高的傳輸速率發展來滿足高畫質的影音傳輸需求，由於近年來製程演進使得處理器及記憶體等運算單元及儲存元件之間的溝通量越來越大，傳統匯流排已不敷使用，因此高速串列傳輸系統逐漸取代傳統的並行傳輸方式。本論文實現一個3-Gb/s之類比等化器結合鎖相迴路基底之週期性嵌入式時脈編碼時脈資料回復電路，主要可以分為三個部分分別探討。第一部份我們先介紹類比等化器與鎖相迴路及內部子電路的架構原理與分析，並針對類比等化器與時脈與資料回復的特性及抖動的分析。第二部分我們分別介紹類比等化器與時脈與資料回復實現方法與演進簡略介紹，透過引用相關實現技巧的舉例來了解不同實現方式的優缺點。最後一部分我們利

用Spectrum-balancing Technique作為判斷機制來實現類比等化器，此方法是藉由資料頻譜本身的特性來自我判斷，並利用鎖相迴路的特性來實現時脈與資料回復電路，因此跟傳統的時脈與資料回復電路相比有快速還原資料的能力與穩定性的輸出頻率。採用UMC 0.18-um 1P6M CMOS製程實現晶片，電路總面積為0.308 mm2，輸入資料頻率為3-Gb/s，在供應電壓為1.8V的操作下，取樣速率為1Gb/s，經模擬驗證輸出回復時脈抖動為17.4ps，並列輸出的回復資料抖動分別為17.7ps、12.8ps、16.6ps。類比等化器消耗功率約為14 mW，時脈與資料回復電路消耗功率約為4

2 mW，其總消耗功率約為56 mW。

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